三极管基极下拉电阻作用

　　1）避免三极管受噪音信号的影响而产生误动作，使晶体管截止更可靠！三极管的基极不可出現悬空，当输入信号不确定时（如输入信号为高阻态时），加下拉电阻，就能使有效接地。

　　特别是GPIO连接此基极的时候，通常在GPIO所处IC刚刚上电初始化的时候，此GPIO的內部也处在一种通电状态，很不稳定，非常容易产生噪声，引起误动作！加此电阻，可消除此影响（假如出現一尖脉冲电平，由于時间较为短，所以这个电压很容易被电阻拉低；假若高电平的時间较为长，那就不可拉低了，也就是正常高电平时沒有影响）！

　　但是电阻不可过小，影响泄漏电流！（过小则会有较大的电流由电阻流入地）

　　2）当三极管开关作用时，ON和OFF時间越短越好，为了防止在OFF时，因晶体管中的残余电荷引起的時间滞后，在B，E之间加一个R起着放电作用。高頻，深饱和时特别要注意。（次要）

　　3）三极管基级加电阻主要是为了设置一个偏置电压，这样就不会出現信号的失真（这在输入信号有交流时极其重要：如当溫度上升时，Ic将增大，导致Ie也会增大，那麼在Re上的压降也增大，而Vbe=Vb-IeRe，而Vb此时基本上被下拉电阻保持住，所以使Vbe减小。当然这个减小对0.7v来说是很小的，是从微观上去分析的。Vbe的减小，使Ib减小，结果牵制了Ic的增加，从而使Ic基本恒定。这也是反馈控制的原理）。

　　并且同时還是为了防止输入电流过大，加个电阻可以分一部分电流，这样就不会让大电流直接流入三极管而损坏其．至于为了放电，一般是在MOS管中才用，三极管这个问題不大．

　　4）如果三极管不接下拉电阻，就不能设定偏置电压，这样会产生输入信号的交越失真，而且输 入电流过大的时候会导致大电流直接流入三极管而损坏其．三极管我们分析的时候有时候总是认为它的內部是有二极管的效应的，但这样是错误的认识，应该更正．而MOS管同样需要一个偏制电压，而下拉电阻可以起到这样的作用，我们一般称为GATE偏制．由于MOS管內部的三个级是相互绝缘的，所以自然会有电容效应在，当信号消失的时候內部的等效电容可以通过下拉电阻进行放电．并且也是必须的，否则会逻辑出错．

　　接下拉电阻时需注意：

　　1、下拉电阻阻值不可太大，要不然会导致流入基级的电流太小

　　2、假如是髙速开关信号，尽可能在下拉电阻上并连一个电容以提高髙速性能

　　三极管基极上拉电阻和下拉电阻如何计算

　　输出端的接电源或接地的电阻叫上拉、下拉电阻，而基极电阻不叫这一名称，应该叫基极偏置电路分压电阻。

　　根据基极所需的偏置电压以及电源电压大小，用电阻分压公式计算Ub=Vcc*R2/（R1+R2），电阻值的大小应该在kΩ~十kΩ数量级，保证电阻上的电流比基极电流大一个数量级。

　　比如说基极偏压需要2V，电源电压6V，取下偏置电阻10kΩ，可以算出上偏置电阻为20kΩ。

　　关于怡海能达

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